La ley de Moore ha impulsado el aumento de las dimensiones y el rendimiento de los dispositivos electrónicos digitales en los últimos 50 años. Como resultado, los componentes lógicos de un sistema en chip (SoC) han mostrado una espectacular mejora del rendimiento. Por otro lado, las interconexiones en el chip, que antes de la década de 1990 se consideraban únicamente una carga parasitaria, se han convertido en el verdadero cuello de botella del rendimiento debido a la dimensión extremadamente reducida de su sección transversal. Las dimensiones de la sección transversal de las interconexiones, cada vez más reducidas, dan lugar a un aumento de la resistencia. Si se combinan todos estos factores, la degradación de la constante de tiempo RC de los cables metálicos en el chip se vuelve más grave. Como resultado, la continua degradación del rendimiento de las interconexiones de Cu/bajo k en el chip es uno de los mayores retos para mantener viva la ley de Moore, mientras que el escalado de la dimensión de los transistores ha proporcionado una incesante mejora del retardo.
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El Dr. Y. Amar Babu recibió el título de B.Tech., En Ingeniería Electrónica y Comunicaciones en el año 1999 de Velagapudi Ramakrishna Siddhartha Engineering College, Acharya Nagarjuna University, Guntur, Andhra Pradesh, India. Obtuvo su maestría en Diseño VLSI en el año 2002 de PSG College of Technology, Bharathiar University.
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Taschenbuch. Zustand: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -La ley de Moore ha impulsado el aumento de las dimensiones y el rendimiento de los dispositivos electrónicos digitales en los últimos 50 años. Como resultado, los componentes lógicos de un sistema en chip (SoC) han mostrado una espectacular mejora del rendimiento. Por otro lado, las interconexiones en el chip, que antes de la década de 1990 se consideraban únicamente una carga parasitaria, se han convertido en el verdadero cuello de botella del rendimiento debido a la dimensión extremadamente reducida de su sección transversal. Las dimensiones de la sección transversal de las interconexiones, cada vez más reducidas, dan lugar a un aumento de la resistencia. Si se combinan todos estos factores, la degradación de la constante de tiempo RC de los cables metálicos en el chip se vuelve más grave. Como resultado, la continua degradación del rendimiento de las interconexiones de Cu/bajo k en el chip es uno de los mayores retos para mantener viva la ley de Moore, mientras que el escalado de la dimensión de los transistores ha proporcionado una incesante mejora del retardo. 176 pp. Spanisch. Bestandsnummer des Verkäufers 9786204283883
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Taschenbuch. Zustand: Neu. Red basada en SDM modificada en chip | Amar Babu (u. a.) | Taschenbuch | Spanisch | 2021 | Ediciones Nuestro Conocimiento | EAN 9786204283883 | Verantwortliche Person für die EU: preigu GmbH & Co. KG, Lengericher Landstr. 19, 49078 Osnabrück, mail[at]preigu[dot]de | Anbieter: preigu Print on Demand. Bestandsnummer des Verkäufers 121280712
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Taschenbuch. Zustand: Neu. This item is printed on demand - Print on Demand Titel. Neuware -La ley de Moore ha impulsado el aumento de las dimensiones y el rendimiento de los dispositivos electrónicos digitales en los últimos 50 años. Como resultado, los componentes lógicos de un sistema en chip (SoC) han mostrado una espectacular mejora del rendimiento. Por otro lado, las interconexiones en el chip, que antes de la década de 1990 se consideraban únicamente una carga parasitaria, se han convertido en el verdadero cuello de botella del rendimiento debido a la dimensión extremadamente reducida de su sección transversal. Las dimensiones de la sección transversal de las interconexiones, cada vez más reducidas, dan lugar a un aumento de la resistencia. Si se combinan todos estos factores, la degradación de la constante de tiempo RC de los cables metálicos en el chip se vuelve más grave. Como resultado, la continua degradación del rendimiento de las interconexiones de Cu/bajo k en el chip es uno de los mayores retos para mantener viva la ley de Moore, mientras que el escalado de la dimensión de los transistores ha proporcionado una incesante mejora del retardo.VDM Verlag, Dudweiler Landstraße 99, 66123 Saarbrücken 176 pp. Spanisch. Bestandsnummer des Verkäufers 9786204283883
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Taschenbuch. Zustand: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - La ley de Moore ha impulsado el aumento de las dimensiones y el rendimiento de los dispositivos electrónicos digitales en los últimos 50 años. Como resultado, los componentes lógicos de un sistema en chip (SoC) han mostrado una espectacular mejora del rendimiento. Por otro lado, las interconexiones en el chip, que antes de la década de 1990 se consideraban únicamente una carga parasitaria, se han convertido en el verdadero cuello de botella del rendimiento debido a la dimensión extremadamente reducida de su sección transversal. Las dimensiones de la sección transversal de las interconexiones, cada vez más reducidas, dan lugar a un aumento de la resistencia. Si se combinan todos estos factores, la degradación de la constante de tiempo RC de los cables metálicos en el chip se vuelve más grave. Como resultado, la continua degradación del rendimiento de las interconexiones de Cu/bajo k en el chip es uno de los mayores retos para mantener viva la ley de Moore, mientras que el escalado de la dimensión de los transistores ha proporcionado una incesante mejora del retardo. Bestandsnummer des Verkäufers 9786204283883
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