Inhaltsangabe
Cet ouvrage propose la conception et l'architecture d'un processeur double c?ur en pipeline à évolutivité dynamique. La méthodologie de conception repose sur la fusion des c?urs de deux processeurs, où deux c?urs indépendants peuvent se transformer dynamiquement en une unité de traitement plus grande, ou être utilisés comme éléments de traitement distincts pour atteindre des performances séquentielles et parallèles élevées. Le processeur offre deux modes d'exécution. Le mode 1 est un mode multiprogrammation pour l'exécution de flux d'instructions de faible largeur de données, c'est-à-dire que chaque c?ur peut effectuer des opérations 16 bits individuellement. Les performances sont améliorées dans ce mode grâce à l'exécution parallèle des instructions dans les deux c?urs, au détriment de l'espace. Dans le mode 2, les deux c?urs de traitement sont couplés et se comportent comme une seule unité de traitement à largeur de données élevée, c'est-à-dire qu'ils peuvent effectuer des opérations 32 bits. Une communication supplémentaire entre les c?urs est nécessaire pour mettre en ?uvre ce mode. Le mode peut changer de manière dynamique ; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la vérification du processeur ont été réalisées avec succès à l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a été vérifié à la fois en simulation et en synthèse à l'aide de programmes de test.
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Über die Autorin bzw. den Autor
J'ai obtenu mon master en technologie à l'Institut national de technologie de Bhopal et ma licence en technologie avec mention à l'Université technique de Rajasthan à Kota. Je travaille actuellement sur les processeurs graphiques (GPU). Mon domaine de recherche est l'architecture VLSI et le traitement d'images.
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Processeur RISC double cur avec mat?riel configurable ? l'aide de VERILOG
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Processeur RISC double coeur avec matériel configurable à l'aide de VERILOG (French Edition)
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Processeur RISC double coeur avec mat?riel configurable ? l'aide de VERILOG
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Processeur RISC double coeur avec matriel configurable l'aide de VERILOG (Paperback)
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Paperback. Zustand: new. Paperback. Cet ouvrage propose la conception et l'architecture d'un processeur double coeur en pipeline a evolutivite dynamique. La methodologie de conception repose sur la fusion des coeurs de deux processeurs, ou deux coeurs independants peuvent se transformer dynamiquement en une unite de traitement plus grande, ou etre utilises comme elements de traitement distincts pour atteindre des performances sequentielles et paralleles elevees. Le processeur offre deux modes d'execution. Le mode 1 est un mode multiprogrammation pour l'execution de flux d'instructions de faible largeur de donnees, c'est-a-dire que chaque coeur peut effectuer des operations 16 bits individuellement. Les performances sont ameliorees dans ce mode grace a l'execution parallele des instructions dans les deux coeurs, au detriment de l'espace. Dans le mode 2, les deux coeurs de traitement sont couples et se comportent comme une seule unite de traitement a largeur de donnees elevee, c'est-a-dire qu'ils peuvent effectuer des operations 32 bits. Une communication supplementaire entre les coeurs est necessaire pour mettre en oeuvre ce mode. Le mode peut changer de maniere dynamique; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la verification du processeur ont ete realisees avec succes a l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a ete verifie a la fois en simulation et en synthese a l'aide de programmes de test. This item is printed on demand. Shipping may be from multiple locations in the US or from the UK, depending on stock availability. Bestandsnummer des Verkäufers 9786209230691
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Processeur RISC double c¿ur avec matériel configurable à l'aide de VERILOG
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Editions Notre Savoir Nov 2025, 2025
ISBN 10: 6209230695
ISBN 13: 9786209230691
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Processeur RISC double coeur avec mat?riel configurable ? l'aide de VERILOG
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Processeur RISC double coeur avec matriel configurable l'aide de VERILOG (Paperback)
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Paperback. Zustand: new. Paperback. Cet ouvrage propose la conception et l'architecture d'un processeur double coeur en pipeline a evolutivite dynamique. La methodologie de conception repose sur la fusion des coeurs de deux processeurs, ou deux coeurs independants peuvent se transformer dynamiquement en une unite de traitement plus grande, ou etre utilises comme elements de traitement distincts pour atteindre des performances sequentielles et paralleles elevees. Le processeur offre deux modes d'execution. Le mode 1 est un mode multiprogrammation pour l'execution de flux d'instructions de faible largeur de donnees, c'est-a-dire que chaque coeur peut effectuer des operations 16 bits individuellement. Les performances sont ameliorees dans ce mode grace a l'execution parallele des instructions dans les deux coeurs, au detriment de l'espace. Dans le mode 2, les deux coeurs de traitement sont couples et se comportent comme une seule unite de traitement a largeur de donnees elevee, c'est-a-dire qu'ils peuvent effectuer des operations 32 bits. Une communication supplementaire entre les coeurs est necessaire pour mettre en oeuvre ce mode. Le mode peut changer de maniere dynamique; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la verification du processeur ont ete realisees avec succes a l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a ete verifie a la fois en simulation et en synthese a l'aide de programmes de test. This item is printed on demand. Shipping may be from our Sydney, NSW warehouse or from our UK or US warehouse, depending on stock availability. Bestandsnummer des Verkäufers 9786209230691
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Processeur RISC double coeur avec matriel configurable l'aide de VERILOG (Paperback)
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Paperback. Zustand: new. Paperback. Cet ouvrage propose la conception et l'architecture d'un processeur double coeur en pipeline a evolutivite dynamique. La methodologie de conception repose sur la fusion des coeurs de deux processeurs, ou deux coeurs independants peuvent se transformer dynamiquement en une unite de traitement plus grande, ou etre utilises comme elements de traitement distincts pour atteindre des performances sequentielles et paralleles elevees. Le processeur offre deux modes d'execution. Le mode 1 est un mode multiprogrammation pour l'execution de flux d'instructions de faible largeur de donnees, c'est-a-dire que chaque coeur peut effectuer des operations 16 bits individuellement. Les performances sont ameliorees dans ce mode grace a l'execution parallele des instructions dans les deux coeurs, au detriment de l'espace. Dans le mode 2, les deux coeurs de traitement sont couples et se comportent comme une seule unite de traitement a largeur de donnees elevee, c'est-a-dire qu'ils peuvent effectuer des operations 32 bits. Une communication supplementaire entre les coeurs est necessaire pour mettre en oeuvre ce mode. Le mode peut changer de maniere dynamique; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la verification du processeur ont ete realisees avec succes a l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a ete verifie a la fois en simulation et en synthese a l'aide de programmes de test. This item is printed on demand. Shipping may be from our UK warehouse or from our Australian or US warehouses, depending on stock availability. Bestandsnummer des Verkäufers 9786209230691
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