Cet ouvrage propose la conception et l'architecture d'un processeur double c?ur en pipeline à évolutivité dynamique. La méthodologie de conception repose sur la fusion des c?urs de deux processeurs, où deux c?urs indépendants peuvent se transformer dynamiquement en une unité de traitement plus grande, ou être utilisés comme éléments de traitement distincts pour atteindre des performances séquentielles et parallèles élevées. Le processeur offre deux modes d'exécution. Le mode 1 est un mode multiprogrammation pour l'exécution de flux d'instructions de faible largeur de données, c'est-à-dire que chaque c?ur peut effectuer des opérations 16 bits individuellement. Les performances sont améliorées dans ce mode grâce à l'exécution parallèle des instructions dans les deux c?urs, au détriment de l'espace. Dans le mode 2, les deux c?urs de traitement sont couplés et se comportent comme une seule unité de traitement à largeur de données élevée, c'est-à-dire qu'ils peuvent effectuer des opérations 32 bits. Une communication supplémentaire entre les c?urs est nécessaire pour mettre en ?uvre ce mode. Le mode peut changer de manière dynamique ; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la vérification du processeur ont été réalisées avec succès à l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a été vérifié à la fois en simulation et en synthèse à l'aide de programmes de test.
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J'ai obtenu mon master en technologie à l'Institut national de technologie de Bhopal et ma licence en technologie avec mention à l'Université technique de Rajasthan à Kota. Je travaille actuellement sur les processeurs graphiques (GPU). Mon domaine de recherche est l'architecture VLSI et le traitement d'images.
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Taschenbuch. Zustand: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Cet ouvrage propose la conception et l'architecture d'un processeur double coeur en pipeline à évolutivité dynamique. La méthodologie de conception repose sur la fusion des coeurs de deux processeurs, où deux coeurs indépendants peuvent se transformer dynamiquement en une unité de traitement plus grande, ou être utilisés comme éléments de traitement distincts pour atteindre des performances séquentielles et parallèles élevées. Le processeur offre deux modes d'exécution. Le mode 1 est un mode multiprogrammation pour l'exécution de flux d'instructions de faible largeur de données, c'est-à-dire que chaque coeur peut effectuer des opérations 16 bits individuellement. Les performances sont améliorées dans ce mode grâce à l'exécution parallèle des instructions dans les deux coeurs, au détriment de l'espace. Dans le mode 2, les deux coeurs de traitement sont couplés et se comportent comme une seule unité de traitement à largeur de données élevée, c'est-à-dire qu'ils peuvent effectuer des opérations 32 bits. Une communication supplémentaire entre les coeurs est nécessaire pour mettre en oeuvre ce mode. Le mode peut changer de manière dynamique ; ce processeur peut donc offrir plusieurs fonctions avec une conception unique. La conception et la vérification du processeur ont été réalisées avec succès à l'aide de Verilog sur la plateforme Xilinx 14.1. Le processeur a été vérifié à la fois en simulation et en synthèse à l'aide de programmes de test. Bestandsnummer des Verkäufers 9786209230691
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