Delay Aware Topology Generation for Network on Chip

Sprache: Englisch

Verlag: LAP LAMBERT Academic Publishing, 2015

3659693022 / 9783659693021

Anbieter: AHA-BUCH GmbH, Einbeck, DeutschlandAHA-BUCH GmbH

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nach der Bestellung gedruckt Neuware - Printed after ordering - Network-on-Chip (NoC) is a scalable bandwidth requirement that using on-chip packet-switched micro-network of interconnects. NoC are based on System-on-Chips(SoCs) that traditionally large-scale multi-processors and distributed computing networks. The NoC performances analysis were evaluated in terms of throughput, queue size, loss and wait time. Meanwhile, Video Object Plane Decoder (VOPD) with 16 cores were used to measured the delay aware topology of NoC. Analysis performances of VOPD is based on the value of hops involved, since VOPD is divided into bisection and quadsection form. Overall, the report proved that the decreased number of hops of VOPD will give a low rate of delay in NoC performances.

Bestandsnummer des Verkäufers 9783659693021

Titel
Delay Aware Topology Generation for Network on Chip
Autor
Asrani Lit
Verlag
LAP LAMBERT Academic Publishing
Erscheinungsjahr
2015
Zustand
Neu
Einband
Taschenbuch
Sprache
Englisch
ISBN-10
3659693022
ISBN-13
9783659693021
Artikelgewicht
125 Gramm
Abmessungen
220x150x5 mm

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