ASIC Implementation of Pezaris Multiplier in DIT FFT Architectures

Sprache: Englisch

Verlag: LAP LAMBERT Academic Publishing, 2018

6139900611 / 9786139900619

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nach der Bestellung gedruckt Neuware - Printed after ordering - Multipliers with large bit lengths have a major impact on the performance of digital circuits in many applications like cryptography, digital signal processing and image processing. The performances of many computational problems are often dominated by the speed at which a multiplication operation can be executed. This book gives a brief overview of various multipliers such as Baugh Wooley, Pezaris, Array, Booth, Vedic multipliers and Compressor based multipliers. The main objective is to compare various types of multiplier in terms of power consumption, area and delay. These signed multiplication concepts are implemented in Verilog HDL and implemented in Cadence RTL Compiler with 180nm technology.

Bestandsnummer des Verkäufers 9786139900619

Titel
ASIC Implementation of Pezaris Multiplier in DIT FFT Architectures
Autor
Saranya Karunamurthi
Verlag
LAP LAMBERT Academic Publishing
Erscheinungsjahr
2018
Zustand
Neu
Einband
Taschenbuch
Sprache
Englisch
ISBN-10
6139900611
ISBN-13
9786139900619
Artikelgewicht
96 Gramm
Abmessungen
220x150x4 mm

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